- 爆速仪是一种用来测量火药爆炸速度的仪器,其性能的优劣及稳定性对测速的结果将有直接影响。传统爆速仪的前端计数电路一般都是采用分立元器件实现,结构拥挤,且保密性不高。为了在满足爆速仪设计的微型化的同时满足较高时钟要求,在爆速仪的前端计数模块和自检电路部分的设计中利用CPLD器件代替传统的分立元器件电路,并利用Qu-artusⅡ软件对设计进行仿真。
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爆速仪 计数器 CPLD
- 今天，大多数的CPLD（复杂可编程逻辑器件）都采用可减少功耗的工作模式，但当系统未使用时，应完全切断电源以保存电池能量，从而实现很多设计者的终极节能目标。描述了如何在一片CPLD 上增加几只分立元件，实现一个节省电池能量的系统断电电路。
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按键开关矩阵 系统断电电路 CPLD
- 在嵌入式系统中，花费大量的中断源来扩展串口无疑是大量的资源浪费。针对这种情况，为了节省紧张的系统资源，本文提出一种实现高效多串口中断方案，可以利用单一的中断源来管理多个扩展串口，并保证多个串口中断的无漏检测与服务。
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多串口中断源 电平转换 CPLD
- 时钟脉冲计数器的输出经过3 线—8 线译码器译码其输出信号接到八位数码管的阴极Vss0、Vss1、Vss2、Vss3、Vss4、Vss5、Vss6、Vss7 端。要显示的数据信息Ａ～Ｈ中哪一个，通过八选一数据选择器的地址码来选择，选择出的数据信息经七段译码器译码接数码管的a～g 管脚。这样八个数码管就可以轮流显示八个数字，如果时钟脉冲频率合适，可实现八个数码管同时被点亮的视觉效果。
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八位数码管 共阴极 CPLD
- 文所要设计的是一种脱机型仪表硬件平台。平台应可以满足一般的数据采集的实时性要求，可以灵活的适用于多种不同的应用场合，可实现多种类型信号的采集和处理，结构小巧紧凑，便于现场处理，还能与PC机或其他设备进行通信和交换数据。对此，我们构建了基于DSP和CPLD技术的硬件平台。
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图像采集 仪表硬件平台 CPLD
- SDRAM的读写逻辑复杂，最高时钟频率达100 MHz以上，普通单片机无法实现复杂的SDRAM控制操作，复杂可编程逻辑器件CPLD具有编程方便，集成度高，速度快，价格低等优点。因此选用CPLD设计SDRAM接口控制模块，简化主机对SDRAM的读写控制。通过设计基于CPLD的SDRAM控制器接口，可以在STM系列、ARM系列、STC系列等单片机和DSP等微处理器的外部连接SDRAM，增加系统的存储空间。
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刷新时序 CPLD SDRAM
- 为了实现PC机与CPLD的通信，进行了相应的研究。分析了RS-232C通信协议，自定义了数据包传输格式。根据UART模块工作状态多的特点，应用了有限状态机理论进行编程实现。为降低误码率，应用16倍频技术，实现了波特率为9 600 bit／s的串口通信。在Quartus II平台上用VerilogHDL进行编程，并通过了VC编写程序的数据传输的验证。研究成果为工程上PC机与嵌入式系统数据传输的问题提供了一种解决方法。
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有限状态机 数据包 CPLD
- 本文介绍一种通用的基于CPLD的片内振荡器设计方法，它基于环形振荡器原理，只占用片上普通逻辑资源(LE)，无需使用专用逻辑资源(如MaxII中的UFM)，从而提高了芯片的资源利用率。
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片内振荡器 SoC CPLD
- 如果仅用一个延迟模块就能同时完成脉冲前后沿的延迟，这样就即节省了电路制作成本又提高了延迟线的延迟精度。本文正是基于这一思想并使用CPLD芯片来实现数字延迟线的设计的。
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数字延迟线 延迟误差 CPLD
- 本文针对光纤通信传输码型的要求和CMI码的编码原理，介绍了一种以EPM系列7064芯片为硬件平台，以Max+PlusⅡ为软件平台，以VHDL为开发工具，适合于CPLD实现的CMI编码器的设计方案。
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CMI编码 光纤通信 CPLD
- GPIB控制器芯片是组建自动测试系统的核心，在测试领域应用广泛。本文拟讨论用ALTERA公司的低成本 CPLD 来实现 GPIB 控制器的功能。GPIB 控制器芯片的硬件设计主 要分为状态机的实现、数据通道和微处理接口的设计。本文重点介绍了各个模块的实现原理。
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GPIB控制器 自动测试系统 CPLD
- 如果能充分利用P89C669的丰富的线性地址资源，将能大大增强系统能力。在一个嵌入式系统开发中，笔者采用ALTERA公司的CPLD芯片EPM7032利用这款单片机的线性地址扩展了丰富的外部设备资源。
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线性地址 存储器扩展 CPLD
- 雷达信号的仿真是测试系统中必不可少的。但采用函数/任意波发生器组成测试系统，不仅增加系统成本，而且还给系统软件设计增加不必要的负担。为此，提出了一种基于CPLD的雷达仿真信号的实现方案，它能为机载雷达测试系统提供所需的多种典型的重频脉冲及制导信号。
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雷达信号 任意波发生器 CPLD
- 由于B超中为了增强图像分辨率，通道都比较多，大多是16、24、48、64甚至更多通道。这些通道电子元器件完全一样，要求各通道的一致性要好，在装整机前，最好有测试手段和方法，对所有通道能进行测试，以去除器件本身和焊接电路板中出现的问题，基于此目的，本人设计了B超检测工装。
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B超检测工装 图像分辨率 CPLD
- 介绍了采用CPLD和Flash器件对FPGA实现快速并行配置，并给出了具体的硬件电路设计和关键模块的内部编程思路。
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FPGA配置 JTAG CPLD
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