- 随着设计量和复杂度的不断增加，数字设计验证变得越来越难，所消耗的成本也越来越高。面对这种挑战，验证工程师必须依靠相应的验证工具和方法才行。对于大型的设计，比如上百万门的设计验证，工程师必须使用一整套规范的验证工具；而对于较小的设计，使用具有HDL testbench的仿真器是一个不错的选择。
- 关键字：
仿真验证 仿真测试文件 FPGA Testbench
- 进入波形仿真后点击运行按钮即可出波形，下面我们来验证我们的cpu代码是否正确
大家先看两个图，等会小墨同学会结合这两个图给大家细细讲解仿真过程
我们先来看第一个过程
上电后，cpu先从ROM中读回两个周期的数据，是从ROM的0地址开始的，再对比我们之前定义好的ROM，数据读取正确，读回的数据的前三位是111，即指令码JMP，后13位003c为地址码，JMP指令是将读回的数据
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FPGA testbench
- 本文叙述概括了FPGA应用设计中的要点，包括，时钟树、FSM、latch、逻辑仿真四个部分。
FPGA的用处比我们平时想象的用处更广泛，原因在于其中集成的模块种类更多，而不仅仅是原来的简单逻辑单元(LE)。
早期的FPGA相对比较简单，所有的功能单元仅仅由管脚、内部buffer、LE、RAM构建而成，LE由LUT(查找表)和D触发器构成，RAM也往往容量非常小。
现在的FPGA不仅包含以前的LE，RAM也更大更快更灵活，管教IOB也更加的复杂，支持的IO类型也更多，而且内部还集成了一
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FPGA Testbench
- Testbench，就是测试平台的意思，具体概念就多不介绍了，相信略懂FPGA的人都知道，编写Testbench的主要目的是为了对使用硬件描述语言(HDL)设计的电路进行仿真验证，测试设计电路的功能、部分性能是否与预期的目标相符。
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FPGA Quartus Testbench 开发板 异步复位
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