一种基于FPGA的语音录制与回放系统的设计
1．1芯片工作原理
音频编／解码芯片WM8731上电后必须将工作模式设置在系统要求的状态下，因此上电后需要用VERILOGHDL编写程序模块对芯片的工作模式进行设置。该语音编／解码芯片有多种工作模式，A／D变换后，语音的采样频率与采样位宽都需要根据系统的具体要求，合理配置。语音芯片的配置时序为I2C模式，芯片接口为主模式，即由WM8731提供位时钟，A／D转换和D／A转换的左、右声道控制相位时钟，以及转换后的数据PCM码输送给FPGA处理器。以下为芯片配置字列表，WM8731内部控制字寄存器有16个，在芯片初始化时，在制作ROM表格中完成。相应的程序设置如下：
1.2配置单元模块
配置单元模块综合顶层图如图2所示。从程序编译分析报告(见图3)可以得出，该单元模块消耗了101个逻辑单元，它作为语音采集模块的一个子模块。在配置电路中，模块CLOCK_50将输入的50MHz系统时钟分频为1MHz，作为I2C总线模块的工作时钟，CLOCK_50模块中写出的上面程序代码是一个表格，存储了配置的控制字。I2C总线模块的I2C_SDAT和I2C_SCLK是数据线和时钟线，DE2板固定分配了专门的I2C数据线和时钟线的引脚线。
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