TD-LTE射频一致性测试系统数字中频单元设计
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改进型DDC与DUC的FPGA实现方案相对于常规方案简化了算法模型、降低了资源消耗，增强了模块的可靠性与可维护性，在进行IQ调制/解调的同时，使得采样率降为目标采样率的一半。DDC/DUC资源消耗情况如表1所示。
本文引用地址：http://www.amcfsurvey.com/article/192732.htm
多相数字滤波器幅频、相频传输函数：
公式(3)、(4)表明I路与Q两路具有相同的幅频响应，相频响应群延时相差Ts/2。
多速率抽取与插值模块设计[7-10]
TD-LTE协议规定基带采样率为30.72MHz，因此DDC之后只需采用一级半带滤波器(Half-band Filter)，即可完成IF信号到基带信号速率转换，抽取器如图5所示。
DUC之前采样率为307.2MHz，因此，插值因子为10，需采用半带滤波器与CIC(Cascaded-integrated-comb Filter)积分级联梳妆滤波器相组合完成插值器功能，插值器如图6所示。
其中，半带滤波器设计应满足公式(5)、(6)、(7)要求，CIC滤波器设计应满足公式(8)要求。
半带滤波器的冲激响应h(k)除了零点(含奇数点)不为零外，其所有的偶数点均为0，所以采用半带滤波器实现采样率变换时，只需一半的计算量，有很高的计算效率，特别适合于信号的实时处理。
HI为积分器传输函数，HC为梳妆滤波器传输函数，N为阶数，R为插值因子，M为差分延迟。
积分级联梳妆滤波器(CIC)仅利用加法器、减法器和寄存器，占用资源少，实现简单且速度高。归一化后的抽取/插值半带滤波器频响如图7所示。归一化后的插值CIC滤波器频响如图8所示。
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